Pin Allocation Tables

Table . 28-Pin Allocation Table
I/O	28-pin SPDIP/SOIC/SSOP	28-pin VQFN	ADC	Reference	Comparator	NCO	DAC	DSM	Timers	CCP	PWM	CWG	MSSP	ZCD	EUSART	CLC	CLKR	Interrupts	Pull-up	Basic
RA0	2	27	ANA0	—	C1IN0- C2IN0-	—	—	—	—	—	—	—	—	—	—	CLCIN0⁽¹⁾	—	IOCA0	Y	—
RA1	3	28	ANA1	—	C1IN1- C2IN1-	—	—	—	—	—	—	—	—	—	—	CLCIN1⁽¹⁾	—	IOCA1	Y	—
RA2	4	1	ANA2	ADCVREF-	C1IN0+ C2IN0+	—	DAC1VREF- DAC1OUT1	—	—	—	—	—	—	—	—	—	—	IOCA2	Y	—
RA3	5	2	ANA3	ADCVREF+	C1IN1+	—	DAC1VREF+	MDCARL⁽¹⁾	—	—	—	—	—	—	—	—	—	IOCA3	Y	—
RA4	6	3	ANA4	—	—	—	—	MDCARH⁽¹⁾	T0CKI⁽¹⁾	CCP5IN⁽¹⁾	—	—	—	—	—	—	—	IOCA4	Y	—
RA5	7	4	ANA5	—	—	—	—	MDSRC⁽¹⁾	—	—	—	—	SS1⁽¹⁾	—	—	—	—	IOCA5	Y	—
RA6	10	7	ANA6	—	—	—	—	—	—	—	—	—	—	—	—	—	—	IOCA6	Y	OSC2 CLKOUT
RA7	9	6	ANA7	—	—	—	—	—	—	—	—	—	—	—	—	—	—	IOCA7	Y	OSC1 CLKIN
RB0	21	18	ANB0	—	C2IN1+	—	—	—	—	CCP4IN⁽¹⁾	—	CWG1IN⁽¹⁾	—	ZCD1	—	—	—	IOCB0	Y	INT⁽¹⁾
RB1	22	19	ANB1	—	C1IN3- C2IN3-	—	—	—	—	—	—	CWG2IN⁽¹⁾	SCK1⁽¹⁾ SCL1^(1,3,4)	—	—	—	—	IOCB1	Y	—
RB2	23	20	ANB2	—	—	—	—	—	—	—	—	CWG3IN⁽¹⁾	SDI1⁽¹⁾ SDA1^(1,3,4) SS1⁽¹⁾	—	—	—	—	IOCB2	Y	—
RB3	24	21	ANB3	—	C1IN2- C2IN2-	—	—	—	—	—	—	—	—	—	—	—	—	IOCB3	Y	—
RB4	25	22	ANB4 ADACT⁽¹⁾	—	—	—	—	—	T5G⁽¹⁾ SMT2WIN⁽¹⁾	—	—	—	—	—	—	—	—	IOCB4	Y	—
RB5	26	23	ANB5	—	—	—	—	—	T1G⁽¹⁾ SMT2SIG⁽¹⁾	CCP3IN⁽¹⁾	—	—	—	—	—	—	—	IOCB5	Y	—
RB6	27	24	ANB6	—	—	—	—	—	—	—	—	—	SDI2⁽¹⁾ SDA2^(1,3,4) SS2⁽¹⁾	—	CK2^(1,3)	CLCIN2⁽¹⁾	—	IOCB6	Y	ICSPCLK ICDCLK
RB7	28	25	ANB7	—	—	—	DAC1OUT2	—	T6IN⁽¹⁾	—	—	—	SCK2⁽¹⁾ SCL2^(1,3,4)	—	RX2⁽¹⁾ DT2^(1,3)	—	—	IOCB7	Y	ICSPDAT ICDDAT
RC0	11	8	ANC0	—	—	—	—	—	T1CKI⁽¹⁾ T3CKI⁽¹⁾ T3G⁽¹⁾ SMT1WIN⁽¹⁾	—	—	—	—	—	—	—	—	IOCC0	Y	SOSCO
RC1	12	9	ANC1	—	—	—	—	—	SMT1SIG⁽¹⁾	CCP2IN⁽¹⁾	—	—	—	—	—	—	—	IOCC1	Y	SOSCI
RC2	13	10	ANC2	—	—	—	—	—	T5CKI⁽¹⁾	CCP1IN⁽¹⁾	—	—	—	—	—	—	—	IOCC2	Y	—
RC3	14	11	ANC3	—	—	—	—	—	T2IN⁽¹⁾	—	—	—	SCK1⁽¹⁾ SCL1^(1,3,4)	—	—	—	—	IOCC3	Y	—
RC4	15	12	ANC4	—	—	—	—	—	—	—	—	—	SDI1⁽¹⁾ SDA1^(1,3,4)	—	—	—	—	IOCC4	Y	—
RC5	16	13	ANC5	—	—	—	—	—	T4IN⁽¹⁾	—	—	—	—	—	—	—	—	IOCC5	Y	—
RC6	17	14	ANC6	—	—	—	—	—	—	—	—	—	—	—	—	CK1^(1,3)	—	IOCC6	Y	—
RC7	18	15	ANC7	—	—	—	—	—	—	—	—	—	—	—	—	RX1⁽¹⁾ DT1^(1,3)	—	IOCC7	Y	—
RE3	1	26	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	IOCE3	Y	MCLR V_PP
V_DD	20	17	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	V_DD
V_SS	8	5	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	V_SS
V_SS	19	16	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	—	V_SS
OUT⁽²⁾	—	—	ADCGRDA	—	C1OUT	NCO1OUT	—	DSM1OUT	TMR0OUT	CCP1OUT	PWM6OUT	CWG1A CWG2A CWG3A	SDO1 SDO2	—	DT1⁽³⁾ DT2⁽³⁾	CLC1OUT	CLKR	—	—	—
	—	—	ADCGRDB	—	C2OUT	—	—	—	—	CCP2OUT	PWM7OUT	CWG1B CWG2B CWG3B	SCK1 SCK2	—	CK1⁽³⁾ CK2⁽³⁾	CLC2OUT	—	—	—	—
	—	—	—	—	—	—	—	—	—	CCP3OUT	—	CWG1C CWG2C CWG3C	SCL1⁽³⁾ SCL2⁽³⁾	—	TX1 TX2	CLC3OUT	—	—	—	—
	—	—	—	—	—	—	—	—	—	CCP4OUT	—	CWG1D CWG2D CWG3D	SDA1⁽³⁾ SDA2⁽³⁾	—	—	CLC4OUT	—	—	—	—
	—	—	—	—	—	—	—	—	—	CCP5OUT	—	—	—	—	—	—	—		—	—

Note:

Default peripheral input. Input can be moved to any other pin with the PPS input selections registers.
All pin outputs default to PORT latch data. Any pin can be selected as a digital peripherals output with the PPS output selection registers.
These peripheral functions are bidirectional. The output pin selections must be the same as the input pin selections.
These pins are configured for I²C logic levels; clock and data signals may be assigned to any of these pins. Assignments to the other pins (e.g., RA5) will operate, but logic levels will be standard TTL/ST as selected y the INLVL register.